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; Copyright (C) 2021 Intel Corporation
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; SPDX-License-Identifier: MIT
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define <4 x i8> @test_xor(<4 x i8> %op) {
; CHECK: %.extend.mask.op = bitcast <4 x i8> %op to <1 x i32>
; CHECK: %1 = xor <1 x i32> %.extend.mask.op, <i32 -1>
; CHECK: %.extend.mask.trunc = bitcast <1 x i32> %1 to <4 x i8>
; CHECK: ret <4 x i8> %.extend.mask.trunc
%1 = xor <4 x i8> %op, <i8 -1, i8 -1, i8 -1, i8 -1>
ret <4 x i8> %1
}
define <4 x i8> @test_or(<4 x i8> %op) {
; CHECK: %.extend.mask.op = bitcast <4 x i8> %op to <1 x i32>
; CHECK: %1 = or <1 x i32> %.extend.mask.op, <i32 1>
; CHECK: %.extend.mask.trunc = bitcast <1 x i32> %1 to <4 x i8>
; CHECK: ret <4 x i8> %.extend.mask.trunc
%1 = or <4 x i8> %op, <i8 1, i8 0, i8 0, i8 0>
ret <4 x i8> %1
}
define <4 x i8> @test_and(<4 x i8> %op) {
; CHECK: %.extend.mask.op = bitcast <4 x i8> %op to <1 x i32>
; CHECK: %1 = and <1 x i32> %.extend.mask.op, <i32 1>
; CHECK: %.extend.mask.trunc = bitcast <1 x i32> %1 to <4 x i8>
; CHECK: ret <4 x i8> %.extend.mask.trunc
%1 = and <4 x i8> %op, <i8 1, i8 0, i8 0, i8 0>
ret <4 x i8> %1
}
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