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4222 4223 4224 4225 4226 4227 4228 4229 4230 4231 4232 4233 4234 4235 4236 4237 4238 4239 4240 4241 4242 4243 4244 4245 4246 4247 4248 4249 4250 4251 4252 4253 4254 4255 4256 4257 4258 4259 4260 4261 4262 4263 4264 4265 4266 4267 4268 4269 4270 4271 4272 4273 4274 4275 4276 4277 4278 4279 4280 4281 4282 4283 4284 4285 4286 4287 4288 4289 4290 4291 4292 4293 4294 4295 4296 4297 4298 4299 4300 4301 4302 4303 4304 4305 4306 4307 4308 4309 4310 4311 4312 4313 4314 4315 4316 4317 4318 4319 4320 4321 4322 4323 4324 4325 4326 4327 4328 4329 4330 4331 4332 4333 4334 4335 4336 4337 4338 4339 4340 4341 4342 4343 4344 4345 4346 4347 4348 4349 4350 4351 4352 4353 4354 4355 4356 4357 4358 4359 4360 4361 4362 4363 4364 4365 4366 4367 4368 4369 4370 4371 4372 4373 4374 4375 4376 4377 4378 4379 4380 4381 4382 4383 4384 4385 4386 4387 4388 4389 4390 4391 4392 4393 4394 4395 4396 4397 4398 4399 4400 4401 4402 4403 4404 4405 4406 4407 4408 4409 4410 4411 4412 4413 4414 4415 4416 4417 4418 4419 4420 4421 4422 4423 4424 4425 4426 4427 4428 4429 4430 4431 4432 4433 4434 4435 4436 4437 4438 4439 4440 4441 4442 4443 4444 4445 4446 4447 4448 4449 4450 4451 4452 4453 4454 4455 4456 4457 4458 4459 4460 4461 4462 4463 4464 4465 4466 4467 4468 4469 4470 4471 4472 4473 4474 4475 4476 4477 4478 4479 4480 4481 4482 4483 4484 4485 4486 4487 4488 4489 4490 4491 4492 4493 4494 4495 4496 4497 4498 4499 4500 4501 4502 4503 4504 4505 4506 4507 4508 4509 4510 4511 4512 4513 4514 4515 4516 4517 4518 4519 4520 4521 4522 4523 4524 4525 4526 4527 4528 4529 4530 4531 4532 4533 4534 4535 4536 4537 4538 4539 4540 4541 4542 4543 4544 4545 4546 4547 4548 4549 4550 4551 4552 4553 4554 4555 4556 4557 4558 4559 4560 4561 4562 4563 4564 4565 4566 4567 4568 4569 4570 4571 4572 4573 4574 4575 4576 4577 4578 4579 4580 4581 4582 4583 4584 4585 4586 4587 4588 4589 4590 4591 4592 4593 4594 4595 4596 4597 4598 4599 4600 4601 4602 4603 4604 4605 4606 4607 4608 4609 4610 4611 4612 4613 4614 4615 4616 4617 4618 4619 4620 4621 4622 4623 4624 4625 4626 4627 4628 4629 4630 4631 4632 4633
|
# RUN: llc -mtriple=x86_64-- -run-pass x86-evex-to-vex-compress -verify-machineinstrs -mcpu=skx -o - %s | FileCheck %s
# This test verifies VEX encdoing for AVX-512 instructions that use registers of low inedexes and
# do not use zmm or mask registers and have a corresponding AVX/AVX2 opcode
--- |
define void @evex_z256_to_vex_test() { ret void }
define void @evex_z128_to_vex_test() { ret void }
define void @evex_scalar_to_vex_test() { ret void }
define void @evex_z256_to_evex_test() { ret void }
define void @evex_z128_to_evex_test() { ret void }
define void @evex_scalar_to_evex_test() { ret void }
...
---
# CHECK-LABEL: name: evex_z256_to_vex_test
# CHECK: bb.0:
name: evex_z256_to_vex_test
body: |
bb.0:
; CHECK: VMOVAPDYmr %rdi, 1, %noreg, 0, %noreg, %ymm0
VMOVAPDZ256mr %rdi, 1, %noreg, 0, %noreg, %ymm0
; CHECK: %ymm0 = VMOVAPDYrm %rip, 1, %noreg, %rax, %noreg
%ymm0 = VMOVAPDZ256rm %rip, 1, %noreg, %rax, %noreg
; CHECK: %ymm0 = VMOVAPDYrr %ymm0
%ymm0 = VMOVAPDZ256rr %ymm0
; CHECK: %ymm0 = VMOVAPDYrr_REV %ymm0
%ymm0 = VMOVAPDZ256rr_REV %ymm0
; CHECK: VMOVAPSYmr %rdi, 1, %noreg, 0, %noreg, %ymm0
VMOVAPSZ256mr %rdi, 1, %noreg, 0, %noreg, %ymm0
; CHECK: %ymm0 = VMOVAPSYrm %rip, 1, %noreg, %rax, %noreg
%ymm0 = VMOVAPSZ256rm %rip, 1, %noreg, %rax, %noreg
; CHECK: %ymm0 = VMOVAPSYrr %ymm0
%ymm0 = VMOVAPSZ256rr %ymm0
; CHECK: %ymm0 = VMOVAPSYrr_REV %ymm0
%ymm0 = VMOVAPSZ256rr_REV %ymm0
; CHECK: %ymm0 = VMOVDDUPYrm %rip, 1, %noreg, %rax, %noreg
%ymm0 = VMOVDDUPZ256rm %rip, 1, %noreg, %rax, %noreg
; CHECK: %ymm0 = VMOVDDUPYrr %ymm0
%ymm0 = VMOVDDUPZ256rr %ymm0
; CHECK: VMOVDQAYmr %rdi, 1, %noreg, 0, %noreg, %ymm0
VMOVDQA32Z256mr %rdi, 1, %noreg, 0, %noreg, %ymm0
; CHECK: %ymm0 = VMOVDQAYrm %rip, 1, %noreg, %rax, %noreg
%ymm0 = VMOVDQA32Z256rm %rip, 1, %noreg, %rax, %noreg
; CHECK: %ymm0 = VMOVDQAYrr %ymm0
%ymm0 = VMOVDQA32Z256rr %ymm0
; CHECK: %ymm0 = VMOVDQAYrr_REV %ymm0
%ymm0 = VMOVDQA32Z256rr_REV %ymm0
; CHECK: VMOVDQAYmr %rdi, 1, %noreg, 0, %noreg, %ymm0
VMOVDQA64Z256mr %rdi, 1, %noreg, 0, %noreg, %ymm0
; CHECK: %ymm0 = VMOVDQAYrm %rip, 1, %noreg, %rax, %noreg
%ymm0 = VMOVDQA64Z256rm %rip, 1, %noreg, %rax, %noreg
; CHECK: %ymm0 = VMOVDQAYrr %ymm0
%ymm0 = VMOVDQA64Z256rr %ymm0
; CHECK: %ymm0 = VMOVDQAYrr_REV %ymm0
%ymm0 = VMOVDQA64Z256rr_REV %ymm0
; CHECK: VMOVDQUYmr %rdi, 1, %noreg, 0, %noreg, %ymm0
VMOVDQU16Z256mr %rdi, 1, %noreg, 0, %noreg, %ymm0
; CHECK: %ymm0 = VMOVDQUYrm %rip, 1, %noreg, %rax, %noreg
%ymm0 = VMOVDQU16Z256rm %rip, 1, %noreg, %rax, %noreg
; CHECK: %ymm0 = VMOVDQUYrr %ymm0
%ymm0 = VMOVDQU16Z256rr %ymm0
; CHECK: %ymm0 = VMOVDQUYrr_REV %ymm0
%ymm0 = VMOVDQU16Z256rr_REV %ymm0
; CHECK: VMOVDQUYmr %rdi, 1, %noreg, 0, %noreg, %ymm0
VMOVDQU32Z256mr %rdi, 1, %noreg, 0, %noreg, %ymm0
; CHECK: %ymm0 = VMOVDQUYrm %rip, 1, %noreg, %rax, %noreg
%ymm0 = VMOVDQU32Z256rm %rip, 1, %noreg, %rax, %noreg
; CHECK: %ymm0 = VMOVDQUYrr %ymm0
%ymm0 = VMOVDQU32Z256rr %ymm0
; CHECK: %ymm0 = VMOVDQUYrr_REV %ymm0
%ymm0 = VMOVDQU32Z256rr_REV %ymm0
; CHECK: VMOVDQUYmr %rdi, 1, %noreg, 0, %noreg, %ymm0
VMOVDQU64Z256mr %rdi, 1, %noreg, 0, %noreg, %ymm0
; CHECK: %ymm0 = VMOVDQUYrm %rip, 1, %noreg, %rax, %noreg
%ymm0 = VMOVDQU64Z256rm %rip, 1, %noreg, %rax, %noreg
; CHECK: %ymm0 = VMOVDQUYrr %ymm0
%ymm0 = VMOVDQU64Z256rr %ymm0
; CHECK: %ymm0 = VMOVDQUYrr_REV %ymm0
%ymm0 = VMOVDQU64Z256rr_REV %ymm0
; CHECK: VMOVDQUYmr %rdi, 1, %noreg, 0, %noreg, %ymm0
VMOVDQU8Z256mr %rdi, 1, %noreg, 0, %noreg, %ymm0
; CHECK: %ymm0 = VMOVDQUYrm %rip, 1, %noreg, %rax, %noreg
%ymm0 = VMOVDQU8Z256rm %rip, 1, %noreg, %rax, %noreg
; CHECK: %ymm0 = VMOVDQUYrr %ymm0
%ymm0 = VMOVDQU8Z256rr %ymm0
; CHECK: %ymm0 = VMOVDQUYrr_REV %ymm0
%ymm0 = VMOVDQU8Z256rr_REV %ymm0
; CHECK: %ymm0 = VMOVNTDQAYrm %rip, 1, %noreg, %rax, %noreg
%ymm0 = VMOVNTDQAZ256rm %rip, 1, %noreg, %rax, %noreg
; CHECK: VMOVNTDQYmr %rdi, 1, %noreg, 0, %noreg, %ymm0
VMOVNTDQZ256mr %rdi, 1, %noreg, 0, %noreg, %ymm0
; CHECK: VMOVNTPDYmr %rdi, 1, %noreg, 0, %noreg, %ymm0
VMOVNTPDZ256mr %rdi, 1, %noreg, 0, %noreg, %ymm0
; CHECK: VMOVNTPSYmr %rdi, 1, %noreg, 0, %noreg, %ymm0
VMOVNTPSZ256mr %rdi, 1, %noreg, 0, %noreg, %ymm0
; CHECK: %ymm0 = VMOVSHDUPYrm %rip, 1, %noreg, %rax, %noreg
%ymm0 = VMOVSHDUPZ256rm %rip, 1, %noreg, %rax, %noreg
; CHECK: %ymm0 = VMOVSHDUPYrr %ymm0
%ymm0 = VMOVSHDUPZ256rr %ymm0
; CHECK: %ymm0 = VMOVSLDUPYrm %rip, 1, %noreg, %rax, %noreg
%ymm0 = VMOVSLDUPZ256rm %rip, 1, %noreg, %rax, %noreg
; CHECK: %ymm0 = VMOVSLDUPYrr %ymm0
%ymm0 = VMOVSLDUPZ256rr %ymm0
; CHECK: VMOVUPDYmr %rdi, 1, %noreg, 0, %noreg, %ymm0
VMOVUPDZ256mr %rdi, 1, %noreg, 0, %noreg, %ymm0
; CHECK: %ymm0 = VMOVUPDYrm %rip, 1, %noreg, %rax, %noreg
%ymm0 = VMOVUPDZ256rm %rip, 1, %noreg, %rax, %noreg
; CHECK: %ymm0 = VMOVUPDYrr %ymm0
%ymm0 = VMOVUPDZ256rr %ymm0
; CHECK: %ymm0 = VMOVUPDYrr_REV %ymm0
%ymm0 = VMOVUPDZ256rr_REV %ymm0
; CHECK: VMOVUPSYmr %rdi, 1, %noreg, 0, %noreg, %ymm0
VMOVUPSZ256mr %rdi, 1, %noreg, 0, %noreg, %ymm0
; CHECK: %ymm0 = VPANDYrm %ymm0, %rip, 1, %noreg, %rax, %noreg
%ymm0 = VPANDDZ256rm %ymm0, %rip, 1, %noreg, %rax, %noreg
; CHECK: %ymm0 = VPANDYrr %ymm0, %ymm1
%ymm0 = VPANDDZ256rr %ymm0, %ymm1
; CHECK: %ymm0 = VPANDYrm %ymm0, %rip, 1, %noreg, %rax, %noreg
%ymm0 = VPANDQZ256rm %ymm0, %rip, 1, %noreg, %rax, %noreg
; CHECK: %ymm0 = VPANDYrr %ymm0, %ymm1
%ymm0 = VPANDQZ256rr %ymm0, %ymm1
; CHECK: %ymm0 = VPANDNYrm %ymm0, %rip, 1, %noreg, %rax, %noreg
%ymm0 = VPANDNDZ256rm %ymm0, %rip, 1, %noreg, %rax, %noreg
; CHECK: %ymm0 = VPANDNYrr %ymm0, %ymm1
%ymm0 = VPANDNDZ256rr %ymm0, %ymm1
; CHECK: %ymm0 = VPANDNYrm %ymm0, %rip, 1, %noreg, %rax, %noreg
%ymm0 = VPANDNQZ256rm %ymm0, %rip, 1, %noreg, %rax, %noreg
; CHECK: %ymm0 = VPANDNYrr %ymm0, %ymm1
%ymm0 = VPANDNQZ256rr %ymm0, %ymm1
; CHECK: %ymm0 = VPAVGBYrm %ymm0, %rip, 1, %noreg, %rax, %noreg
%ymm0 = VPAVGBZ256rm %ymm0, %rip, 1, %noreg, %rax, %noreg
; CHECK: %ymm0 = VPAVGBYrr %ymm0, %ymm1
%ymm0 = VPAVGBZ256rr %ymm0, %ymm1
; CHECK: %ymm0 = VPAVGWYrm %ymm0, %rip, 1, %noreg, %rax, %noreg
%ymm0 = VPAVGWZ256rm %ymm0, %rip, 1, %noreg, %rax, %noreg
; CHECK: %ymm0 = VPAVGWYrr %ymm0, %ymm1
%ymm0 = VPAVGWZ256rr %ymm0, %ymm1
; CHECK: %ymm0 = VPADDBYrm %ymm0, %rip, 1, %noreg, %rax, %noreg
%ymm0 = VPADDBZ256rm %ymm0, %rip, 1, %noreg, %rax, %noreg
; CHECK: %ymm0 = VPADDBYrr %ymm0, %ymm1
%ymm0 = VPADDBZ256rr %ymm0, %ymm1
; CHECK: %ymm0 = VPADDDYrm %ymm0, %rip, 1, %noreg, %rax, %noreg
%ymm0 = VPADDDZ256rm %ymm0, %rip, 1, %noreg, %rax, %noreg
; CHECK: %ymm0 = VPADDDYrr %ymm0, %ymm1
%ymm0 = VPADDDZ256rr %ymm0, %ymm1
; CHECK: %ymm0 = VPADDQYrm %ymm0, %rip, 1, %noreg, %rax, %noreg
%ymm0 = VPADDQZ256rm %ymm0, %rip, 1, %noreg, %rax, %noreg
; CHECK: %ymm0 = VPADDQYrr %ymm0, %ymm1
%ymm0 = VPADDQZ256rr %ymm0, %ymm1
; CHECK: %ymm0 = VPADDSBYrm %ymm0, %rip, 1, %noreg, %rax, %noreg
%ymm0 = VPADDSBZ256rm %ymm0, %rip, 1, %noreg, %rax, %noreg
; CHECK: %ymm0 = VPADDSBYrr %ymm0, %ymm1
%ymm0 = VPADDSBZ256rr %ymm0, %ymm1
; CHECK: %ymm0 = VPADDSWYrm %ymm0, %rip, 1, %noreg, %rax, %noreg
%ymm0 = VPADDSWZ256rm %ymm0, %rip, 1, %noreg, %rax, %noreg
; CHECK: %ymm0 = VPADDSWYrr %ymm0, %ymm1
%ymm0 = VPADDSWZ256rr %ymm0, %ymm1
; CHECK: %ymm0 = VPADDUSBYrm %ymm0, %rip, 1, %noreg, %rax, %noreg
%ymm0 = VPADDUSBZ256rm %ymm0, %rip, 1, %noreg, %rax, %noreg
; CHECK: %ymm0 = VPADDUSBYrr %ymm0, %ymm1
%ymm0 = VPADDUSBZ256rr %ymm0, %ymm1
; CHECK: %ymm0 = VPADDUSWYrm %ymm0, %rip, 1, %noreg, %rax, %noreg
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